Elastic bus interface data buffer

Details Elastic bus interface data buffer Elastic bus interface data buffer

G - Physics

06

F

G06F 9/38 (2006.01) G06F 13/40 (2006.01)

Patent

CA 2283229

An elastic bus interface receives and registers an external data transfer signal (28) and generates an internal data transfer signal (44) that always begins at the beginning of the subsequent clock cycle regardless of the time of arrival of the external data transfer signal. By employing a plurality of data output registers (54, 56) in a pipeline and using only the internal data transfer signal, data is fed to a bus (25) so as to ensure that almost a complete clock cycle is available for setup time to accomplish data transfer. The invention can operate with high speed buses using only simple conventional circuitry and modest process geometries requiring only minimal chip area and power.

On décrit une interface de bus tampon qui reçoit un signal de transfert de données externes (28) et émet un signal de transfert de données internes (44) qui commence toujours au début du cycle d'horloge subséquent, indépendamment du moment d'arrivée du signal de transfert de données externes. En mettant en oeuvre plusieurs registres (54, 56) de sortie de données dans une pipeline et en n'utilisant que le signal de transfert de données internes, on introduit des données dans un bus (25) de manière à assurer qu'un cycle d'horloge quasi complet est disponible pour que le temps de préparation effectue le transfert de données. Le procédé inventé peut fonctionner avec des bus à haute vitesse utilisant uniquement une simple circuiterie classique et des géométries de traitement modestes qui ne nécessitent qu'un minimum de surface occupée et d'énergie.

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