H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 1/00 (2006.01) H03M 13/35 (2006.01) H04N 7/12 (2006.01) H04N 7/60 (2006.01) H04N 7/66 (2006.01) H04Q 11/04 (2006.01) H04L 7/04 (2006.01) H04L 12/56 (2006.01)
Patent
CA 2133009
In a transmission error correction code appending device which receives a variable bit rate signal transmitted at a variable bit rate and comprising a plurality of information bytes, a transmitting circuit transmits, unless a timer circuit produces a time-out signal, the information bytes to a correction code appending circuit and transmits, when the timer circuit produces the time-out signal, zero bytes to the correction code appending circuit subsequently to the information bytes so that the information bytes and the zero bytes constitute first through N-th data bytes of first through M-th data groups, where each of M and N represents a predetermined plural and natural number. The correction code appending circuit consecutively supplies an interleaver with first through M-th blocks, each comprising the first through the N-th data bytes and first through P-th error correction code bytes as first through Q-th block bytes, where P represents a prescribed natural number, Q being equal to (N + P). An informing signal producer produces an informing signal when the interleaver receives the first block byte of the first block. The timer circuit produces the time-out signal when the timer circuit times a preselected time interval from a time instant at which the timer circuit receives the informing signal.
Dans un dispositif qui ajoute un code correcteur d'erreur et qui reçoit un signal à débit variable constitué de plusieurs octets, un circuit émetteur transmet, sauf lorsqu'un temporisateur génère un signal de dévalidation, les octets à un circuit qui ajoute un code correcteur et qui transmet, lorsque le circuit temporisateur produit le signal de dévalidation, des octets constitués de zéros au circuit qui ajoute le code de correction, après les octets d'information, de sorte que les octets d'information et les octets nuls constituent les octets de données de 1 à N des groupes de données 1 à M, où M et N représentent des entiers naturels. Le circuit qui ajoute le code correcteur insère ensuite un séparateur avec les blocs de 1 à M; les blocs d'octets de 1 à Q sont constitué des octets de données de 1 à N et des octets de code correcteur d'erreur de 1 à P, où P représente un nombre naturel prédéterminé, et où Q est égal à (N + P). Un générateur de signal produit un signal indicateur lorsque le circuit d'entrelacement reçoit le premier octet du premier bloc. Le circuit temporisateur produit le signal de dévalidation après l'écoulement d'un intervalle de temps prédéterminé à partir du moment où il reçoit le signal indicateur.
Juniper Networks Inc.
Ridout & Maybee Llp
LandOfFree
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