Programmable digital intermediate frequency transceiver

H - Electricity – 04 – B

Patent

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Details

H04B 1/38 (2006.01) H03C 3/40 (2006.01) H03D 7/16 (2006.01) H04B 1/28 (2006.01)

Patent

CA 2371090

A monolithic CMOS programmable digital intermediate frequency receiver (20) includes a programmable memory (29), a clock generator (26), a sigma delta converter (22), a digital downconverter (24), and a decimation filter network (28). The programmable memory (29) receives and stores a first value representative of a programmable parameter k and a second value representative of programmable parameter N. Coupled to the programmable memory (29), the clock generator (26) generates a first clock signal, a second clock signal and a third clock signal. The first clock signal has a first frequency, f1, the second clock signal has a second frequency approximately equal to f1/k and the third clock signal has a third frequency approximately equal to f1/N. The sigma delta converter (22), the digital downconverter (24) and the decimation filter network (28) use the respective first, second and third clock signals to generate the respective set of digital signals.

L'invention concerne un récepteur FI (20) numérique, programmable, CMOS, et monolithique comprenant une mémoire programmable (29), un générateur d'horloge (26), un convertisseur sigma-delta (22), un modulateur de fréquence (24) et un réseau de filtre de décimation (28). La mémoire programmable (29) reçoit et stocke une première valeur représentative d'un paramètre programmable k et une seconde valeur représentative d'un paramètre programmable N. Couplé à la mémoire programmable (29) le générateur d'horloge (26) génère un premier signal d'horloge, un deuxième signal d'horloge et un troisième signal d'horloge. Le premier signal d'horloge a une première fréquence f1, le deuxième signal d'horloge a une deuxième fréquence environ égale à f1/k et le troisième signal d'horloge a une troisième fréquence environ égale à f1/N. Le convertisseur sigma-delta (22), le modulateur de fréquence (24) et le réseau de filtre de décimation (28) utilisent les premier, deuxième et troisième signaux pour générer l'ensemble de signaux numériques.

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