H - Electricity
04
N
H04N 7/26 (2006.01)
Patent
CA 2597536
A decoder arrangement (10) includes a processor (12) programmed to decode multiple streams (111-11n), including multiple streams of different formats, In terms of functionality, the decoder arrangement includes a routing stage (13) routes each streams to different decoder stages (141-14n), each capable of decoding a stream of a particular format to yield an uncompressed stream at its output. Each of plurality of buffer stages (161-16n) stores a successive frame of an uncompressed stream output by an associated decoder stage. An output stage scales and the frames stored by the buffer stages to a common size for input to a display device (22).
L'invention concerne un agencement décodeur (10) comprenant un processeur (12) programmé pour décoder des flux multiples (111-11n), notamment des flux multiples de formats différents. En termes de fonctionnalité, cet agencement décodeur comprend un étage de routage (13) destiné à router chaque flux vers des étages décodeurs différents (141-14n), chaque étage étant apte à décoder un flux d'un format particulier pour produire un flux non comprimé à sa sortie. Chaque étage tampon (161-16n) d'une pluralité stocke une trame successive d'un flux non comprimé émis par un étage décodeur associé. Un étage de sortie met à l'échelle les trames stockées par les étages tampons dans une taille commune pour les entrer dans un dispositif d'affichage (22).
Bennett Jones Llp
Gvbb Holdings S.a.r.l.
Thomson Licensing
LandOfFree
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Profile ID: LFCA-PAI-O-1875555