H - Electricity – 03 – M
Patent
H - Electricity
03
M
H03M 13/47 (2006.01) G01V 3/12 (2006.01) H03M 5/12 (2006.01) G07C 9/00 (2006.01) G08C 15/04 (2006.01)
Patent
CA 2397107
An apparatus is described for reducing coherent signal interference between at least two bit streams framed with a common clock signal. The apparatus includes an internal clock signal generated from the common clock signal and a Manchester encoder for encoding the internal clock signal with a unique signature. Also included is a logic AND-gate for combining one bit stream of the two bit streams with the encoded clock signal to produce an encoded output signal. When the encoded output signal is combined with another of the two bit streams during transmission, individual bits of the combined bit streams are identifiable at a receiving end. The receiving end decodes the combined bit streams and properly discriminates between ONEs and ZEROs.
L'invention concerne un appareil permettant de réduire l'interférence des signaux cohérents entre au moins deux courants binaires placés en bloc avec un signal d'horloge commun. L'appareil comprend un signal d'horloge interne généré à partir du signal d'horloge commun et un codeur de Manchester pour coder le signal d'horloge interne avec une signature unique. Cet appareil comprend aussi un circuit logique ET pour combiner un courant binaire des deux courants binaires avec le signal d'horloge codé pour produire un signal de sortie codé. Lorsque le signal de sortie codé est combiné avec un des deux autres courants binaires pendant la transmission, les bits individuels des courants binaires combinés peuvent être identifiés au niveau d'une extrémité de réception. Cette extrémité décode les courants binaires combinés et effectue une discrimination correcte entre les UNs et les ZEROS.
Evans Robert
Lin Min-Long
Schepps Jonathan
Zalud Peter
Dimock Stratton Llp
Sarnoff Corporation
Secom Co. Ltd.
LandOfFree
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Profile ID: LFCA-PAI-O-1877290