G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 12/02 (2006.01) G06F 12/14 (2006.01)
Patent
CA 2387807
A single-chip data processing circuit (100) has a memory management unit (200) and a homogeneous memory device (270). The memory management unit (i) partitions the homogeneous memory device to achieve heterogeneous memory characteristics for various regions of the memory device, and (ii) restricts access of installed applications executing in the microprocessor core to predetermined memory ranges. The memory management unit implements memory address checking using limit registers (325 and 345) and translates virtual addresses to an absolute memory address using offset registers (330 and 350). The memory management unit loads limit and offset registers with the appropriate values from an application table (300) to ensure that the executing application only accesses the designated memory locations.
L'invention concerne un circuit de traitement de données monopuce (100), qui comprend une unité de gestion mémoire (200) et une mémoire homogène (270). L'unité de gestion mémoire i) partitionne la mémoire homogène pour obtenir des caractéristiques de mémoire hétérogènes destinées à diverses zones de la mémoire; et ii) limite l'accès d'applications d'exécution installées dans le noyau du microprocesseur à des champs prédéterminés de la mémoire. L'unité de gestion mémoire effectue une vérification d'adresses mémoire au moyen de registres limites (325 et 345), et traduit des adresses virtuelles en une adresse mémoire absolue en utilisant des registres de désynchronisation (330 et 350). L'unité de gestion mémoire charge dans les registres limites et les registres de désynchronisation les valeurs appropriées tirées d'une table d'application (300) pour assurer que l'application d'exécution n'accède qu'aux emplacements de mémoire indiqués.
Advanced Technology Materials Inc.
Kirby Eades Gale Baker
LandOfFree
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Profile ID: LFCA-PAI-O-1879197