G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/17 (2006.01) G06F 13/40 (2006.01) G06F 15/167 (2006.01)
Patent
CA 2245106
A method and system for input/output control in a multiprocessor system having multiprocessors coupled to a system memory via a common wide bus. The common wide bus is subdivided into multiple sub-buses which may be accessed individually or in groups by a selected processor, or individual sub-buses may be accessed by multiple processors simultaneously in response to one or more transfer requests. In response to a transfer request having a data address associated therewith, a particular target device is identified. The data address is then written into an address queue. Thereafter, one or more of the multiple sub-buses are utilized to transfer data to or from a single processor in response to a transfer request from a single processor. In response to a transfer request from multiple processors, one or more of the multiple sub-buses may be utilized separately to simultaneously transfer data to or from multiple processors.
L'invention est constituée par une méthode et un système de contrôle d'entrée-sortie pour système multiprocesseur dans lequel les processeurs sont couplés à la mémoire par un bus commun à grand débit. Ce bus est subdivisé en plusieurs sous-bus, un processeur particulier pouvant avoir accès à l'un quelconque des sous-bus d'un groupe de sous-bus ou à tous les sous-bus du groupe, ou plusieurs processeurs pouvant avoir accès simultanément aux sous-bus individuels en réponse à une ou à plusieurs demandes de transfert. En réponse à une demande de transfert portant une adresse de données connexe, un dispositif cible particulier est identifié. L'adresse de données est alors inscrite dans une file d'attente d'adresses. Par suite, un ou plusieurs des sous-bus sont utilisés pour effectuer un transfert de données vers un processseur particulier ou à partir d'un processeur particulier en réponse à une demande de transfert provenant d'un processeur particulier. En réponse à une demande de transfert provenant de plusieurs processeurs, plusieurs des sous-bus peuvent être utilisés séparément pour simultanément transférer les données vers plusieurs processeurs ou à partir de plusieurs processeurs.
Kahle James A.
Tran Cang N.
International Business Machines Corporation
Rosen Arnold
LandOfFree
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