G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 11/14 (2006.01) G06F 12/14 (2006.01) G06F 21/00 (2006.01)
Patent
CA 2137506
A data verification system including a circuit verifies that unlocking data generated by a microprocessor to be written into the ASIC before a memory write is valid. The microprocessor is programmed to generate an ASIC address when unlocking data is to be written to the ASIC and to encrypt and decrypt that data. The verifying circuit unit receives the encrypted data and decrypts the encrypted data and compares the decrypted data with the encrypted data. The verifying circuit generating an enable signal only if the comparison is true. An address decoding unit is provided for receiving the memory address signal and causing a memory write enable signal to be generated for the memory unit only if the verifying circuit unit has generated an enable signal. Registers unit in communication with the data bus and the verifying circuit unit are provided for writing decryption parameters in the register unit in accordance with the programming of the microprocessor during power-up of the microprocessor.
Un système de vérification de données comprenant un circuit vérifie la validité de données de déverrouillage générées par un microprocesseur, à enregistrer dans l'ASIC avant une écriture mémoire. Le microprocesseur est programmé pour générer une adresse ASIC au moment de l'enregistrement des données de déverrouillage dans l'ASIC et pour chiffrer et déchiffrer ces données. Le circuit de vérification reçoit les données chiffrées et les déchiffre puis les compare aux données chiffrées. Il ne génère un signal de validation que si la comparaison est vérifiée. Une unité de codage d'adresse permet de recevoir le signal d'adresse mémoire et de causer l'envoi d'un signal de validation d'écriture mémoire à l'unité de mémoire seulement si le circuit de vérification a produit un signal de validation. L'unité de registres, en communication avec le bus de données, et le circuit de vérification permettent d'écrire les paramètres de déchiffrage dans l'unité de registres conformément à la programmation du microprocesseur lors de la mise sous tension du microprocesseur.
Lee Young W.
Moh Sungwon
Muller Arno
Pitney Bowes Inc.
Sim & Mcburney
LandOfFree
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Profile ID: LFCA-PAI-O-2005013