A buffer comprising a voltage level shifting circuit

H - Electricity – 02 – M

Patent

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Details

H02M 3/155 (2006.01) H03H 11/02 (2006.01)

Patent

CA 2686701

A voltage level shifter with an input transistor pair, a cross-coupled load chain transistor pair and a pair of current sources, effects reduced power consumption through the use of the cross-coupled load chain transistor pair to minimize the DC current component present in known voltage level shifters. In specific embodiments, feedback elements may be used to minimize delays in signal transitions. A reference voltage that corresponds to a current capability of the input transistor pair may be used to regulate the current sources in the load chain. Changes in a swing of the input signal voltage received by the input transistor pair may be reflected in corresponding changes to the reference voltage. The voltage level shifter may be of particular use in a buffer.

L'invention concerne un circuit de décalage de niveau de tension comprenant une paire de transistors d'entrée, une paire de transistors de chaîne de charges interconnectés et une paire de sources de courant, ce circuit réduit la consommation de puissance grâce à l'utilisation de la paire de transistors de chaîne de charges interconnectés afin de minimiser la composante de courant continu présente dans des circuits connus de décalage de niveau de tension. Dans des modes de réalisation spécifiques, des éléments de rétroaction peuvent être utilisés pour minimiser les délais de transition des signaux. Une tension de référence qui correspond à une certaine capacité de courant de la paire de transistors d'entrée peut être utilisée pour réguler les sources de courant de la chaîne de charges. Des modifications de l'excursion de la tension du signal d'entrée reçu par la paire de transistors d'entrée peuvent être reflétées dans des modifications correspondantes selon la tension de référence. Le circuit de décalage de niveau de tension peut avoir une utilité particulière dans un circuit tampon.

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