H - Electricity – 04 – B
Patent
H - Electricity
04
B
H04B 7/26 (2006.01) H04L 7/02 (2006.01) H04L 7/04 (2006.01) H04J 13/04 (2006.01) H04B 1/707 (2006.01) H04J 13/00 (2006.01)
Patent
CA 2161258
In a CDMA communication system (100) capable of communicating between a receiver (20) and a transmitter (10) direct sequence spread spectrum communication signals (30), a system and method for synchronizing receiver bit timing and transmitting timing. Transmitter (10) transmits a braining bit sequence (31) followed by a transmitter bit timing sequence (33). The receiver (20) adaptively determines a representation of a despreading chip sequence using a tapped delay line equalizer (400). Receiver bit timing offset is determined based on the representation of the despreading chip sequence and the transmitter bit timing sequence (33).
L'invention concerne un système et un procédé de synchronisation du rythme binaire du récepteur et de l'émetteur, dans un système de communication AMDC (100) assurant l'échange de signaux de communication (30) d'étalement du spectre en séquences directes entre un récepteur (20) et un émetteur (10). L'émetteur (10) émet une séquence binaire d'apprentissage (31) suivie d'une séquence de synchronisation binaire (33) de l'émetteur. Le récepteur (20) détermine de manière adaptative une représentation d'une séquence d'éléments de désétalement au moyen d'un égaliseur à ligne à retard à prise d'appel (400). Le décalage de synchronisation binaire du récepteur est déterminé en fonction de la représentation de la séquence d'éléments de désétalement et de la séquence de synchronisation binaire de l'émetteur (33).
Babayi Robert S.
Cadd Jimmy
Fulghum Tracy L.
Lee Edward K.b.
Gowling Lafleur Henderson Llp
Motorola Inc.
LandOfFree
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Profile ID: LFCA-PAI-O-1996690