A fast controlled output buffer

Details A fast controlled output buffer A fast controlled output buffer

H - Electricity

03

K

H03K 19/003 (2006.01) H03K 17/16 (2006.01)

Patent

CA 2499103

An output buffer switch-on control circuit includes several transistors and a discharge current control circuit. A first transistor has a first terminal connected to an internal voltage line and is controlled by an output data source. A second transistor has a first terminal connected to the internal voltage line and is controlled by a second terminal of the first transistor. The second transistor also has a second terminal connected to a first terminal of an output capacitor. A third transistor is controlled by the output data source and has a first terminal connected to a common voltage. A fourth transistor is digitally controlled and has a first terminal connected to the second terminal of the second transistor. The fourth transistor also has a second terminal connected to the common voltage. The discharge current control circuit is preferably actively-controlled and is connected between a second terminal of the first transistor and a second terminal of the third transistor. The discharge current control circuit preferably includes a discharge resistor and a mirrored current transistor feedback controlled by an output capacitor.

Cette invention se rapporte à un circuit de commande de mise sous tension à tampon de sortie, qui comprend plusieurs transistors et un circuit de commande à courant de décharge. Un premier transistor possède une première borne connectée à une ligne de tension interne et il est commandé par une source de données de sortie. Un second transistor possède une première borne connectée à une ligne de tension interne et il est commandé par une seconde borne du premier transistor. Le second transistor possède également une seconde borne connectée à une première borne d'un condensateur de sortie. Un troisième transistor est commandé par la source de données de sortie et il possède une première borne connectée à une tension commune. Un quatrième transistor est commandé en mode numérique et il possède une première borne connectée à la seconde borne du second transistor. Le quatrième transistor comporte également une seconde borne connectée à la tension commune. Ce circuit de commande à courant de décharge est de préférence commandé en mode actif et il est connecté entre une seconde borne du premier transistor et une seconde borne du troisième transistor. Ce circuit de commande à courant de décharge comprend de préférence une résistance de décharge et une rétroaction par transistor à courant miroir commandée par un condensateur de sortie.

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