A method and device to provide a high-performance...

H - Electricity – 03 – M

Patent

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H03M 1/68 (2006.01) H03M 1/08 (2006.01) H03M 1/74 (2006.01)

Patent

CA 2271061

High-speed and high accuracy digital-to-analog (D/A) converters find many applications in signal processing. For wideband telecommunication systems, there is a strong demand on high-performance D/A converters. With the design of the present invention it is enabled to prevent distortions and intermodulations for high-speed and high-accuracy digital-to-analog (D/A) converters for telecommunication applications, where the requirements on distortion and intermodulation can be very stringent. By combining segmentation for MSBs and binary weighting for LSBs a high-performance digital- to-analog conversion architecture can be achieved, where a delay for the binary weighted LSBs is used to equalize a delay introduced by segmentation and where all bit switches (14) are clocked with a tree-like-clock distribution network (11). New floor plans for CMOS, BiCMOS and bipolar implementation are thus invented and circuits for CMOS bit switches and current sources are also disclosed.

Les convertisseurs numérique-analogique (N/A) à haute précision et à grande vitesse trouvent de nombreuses applications dans le traitement du signal. Dans le domaine des systèmes de télécommunications à large bande il existe une forte demande pour les convertisseurs N/A haute performance. Cette invention permet d'empêcher les distorsions et les intermodulations des convertisseurs numérique-analogique (N/A) à haute précision et à grande vitesse dans des applications de télécommunications pour lesquelles les exigences relatives à la distorsion et l'intermodulation peuvent être très strictes. En combinant la segmentation des bits les plus significatifs (BPS) et la pondération binaire des bits les moins significatifs (NBMS) on peut produire une architecture de conversion numérique-analogique haute performance dans laquelle une attente pour les BMS pondérés binairement est utilisée pour égaliser une attente introduite par la segmentation et dans laquelle tous les commutateurs binaires (14) sont synchronisés par un réseau (11) de distribution d'horloge du type arbre. De nouveaux plans de base pour CMOS, BiCMOS et l'implantation bipolaire sont ainsi inventés et des circuits destinés à des commutateurs binaires à CMOS et des circuits de courant sont également décrits.

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