G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 13/28 (2006.01)
Patent
CA 2504713
A method of exchanging data within a direct memory access (DMA) arrangement including a plurality of IP blocks (A, B, C) includes the step of associating with the IP blocks (A, B, C) respective DMA modules (IDMA A, IDMA B, IDMA C), each DMA module including an input buffer (11A, 11B, 11C) and an output buffer (12A, 12B, 12C). The DMA modules (IDMA A, IDMA B, IDMA C) are coupled over a data transfer facility (BUS) in a chain arrangement wherein each DMA module has at least one of its output buffer (12A, 12B) coupled to the input buffer (11B, 11C) of another DMA module downstream in the chain and its input buffer (11B, 11C) coupled to the output buffer (12A, 12B) of another DMA module upstream in the chain. The DMA modules interact with the respective IP blocks (A, B, C) by writing data from the input buffer (11A, 11B, 11C) of the IDMA module into the respective IP block (A, B, C) and reading data from the respective IP block (A, B, C) into the output buffer (12A, 12B, 12C) of the DMA module. The input (11A, 11B, 11C) and output (12A, 12B, 12C) buffers in the various DMA module are operated in such a way that; - writing of data from the input buffer (11A, 11B, 11C) of the DMA module into the respective IP block (A, B, C) is started when the input buffer (11A, 11B, 11C) is at least partly filled with data; - when said reading of data from the respective IP block (A, B, C) into the output buffer of the DMA module is completed, the data in the output buffer are transferred to the input buffer (11B, 11C) of the DMA module downstream in the chain or, in the case of last DMA module in the chain are provided as output data.
L'invention concerne un procédé d'échange de données dans un agencement d'accès direct en mémoire (DMA) comprenant une pluralité de blocs IP (A, B, C). Ledit procédé comprend l'étape consistant à associer aux blocs IP (A, B, C) des modules DMA (IDMA A, IDMA B, IDMA C) respectifs, chaque module DMA comportant un tampon d'entrée (11A, 11B, 11C) et un tampon de sortie (12A, 12B, 12C). Les modules DMA (IDMA A, IDMA B, IDMA C) sont couplés par un moyen de transfert de données (BUS) dans un agencement en chaîne, au moins l'un des tampons de sortie (12A, 12B) de chaque module DMA étant couplé au tampon d'entrée (11B, 11C) d'un autre module DMA situé plus bas dans la chaîne, et le tampon d'entrée (11B, 11C) de chaque module DMA étant couplé au tampon de sortie (12A, 12B) d'un autre module DMA situé plus haut dans la chaîne. Les modules DMA interagissent avec les blocs IP (A, B, C) respectifs en écrivant des données du tampon d'entrée (11A, 11B, 11C) du module IDMA au bloc IP (A, B, C) respectif, et en lisant des données du bloc IP (A, B, C) respectif au tampon de sortie (12A, 12B, 12C) du module DMA. Les tampons d'entrée (11A, 11B, 11C) et de sortie (12A, 12B, 12C) contenus dans les divers modules DMA fonctionnent de façon que : - l'écriture de données du tampon d'entrée (11A, 11B, 11C) du module DMA au bloc IP (A, B, C) respectif démarre lorsque le tampon d'entrée (11A, 11B, 11C) est au moins partiellement rempli de données ; - lorsque ladite lecture de données du bloc IP (A, B, C) respectif au tampon de sortie du module DMA est achevée, les données contenues dans le tampon de sortie sont transférées vers le tampon d'entrée (11B, 11C) du module DMA situé plus bas dans la chaîne ou, s'il s'agit du dernier module DMA de la chaîne, lesdites données sont fournies sous forme de données de sortie.
Bragagnini Andrea
Varriale Antonio
Ridout & Maybee Llp
Telecom Italia S.p.a.
LandOfFree
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