A method of and system for synchronously communicating data...

H - Electricity – 04 – L

Patent

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H04L 7/10 (2006.01) H04J 3/06 (2006.01) H04L 1/22 (2006.01) H04L 12/12 (2006.01)

Patent

CA 2254817

First and second data sources (106A, 106B) transmit a data signal (TXD) on a data connection and a transmit clock signal (TXC) on a clock connection. The data signal is clocked into a FIFO (226) resident in network interface equipment (110) in response to the transmit clock signal, and out of the FIFO to the network in response to a reference clock signal. The FIFO (226) generates a status signal indicating how full it is and a local clock generator (228) generates the transmit clock signal in response to this status signal. The first and a second data sources (106A, 106B) hold the data signal and transmit clock signal high for longer than a single period of the reference clock signal when switching between them. The local clock generator (228) alters an average rate of the transmit clock signal in response to the status indication signal from the FIFO in order to keep it half-full.

Des première et seconde sources de données (106A, 106B) transmettent un signal de données (TXD) sur une connexion de données et un signal d'horloge de transmission (TXC) sur une connexion d'horloge. Le signal de données est synchronisé dans une mémoire FIFO (226) résidante dans un matériel (110) d'interface réseau en réponse au signal d'horloge de transmission, et synchronisé en sortie de la mémoire FIFO vers le réseau en réponse à un signal d'horloge de référence. La mémoire FIFO (226) génère un signal de statut indiquant son niveau de remplissage et un générateur (228) de rythme local produit le signal d'horloge de transmission en réponse à le signal d'état. Les première et seconde sources de données (106A, 106B) maintiennent le signal de données et elles transmettent le signal d'horloge pendant une durée plus longue qu'une seule période du signal d'horloge de référence lors d'une commutation entre eux. Le générateur (228) de rythme local modifie la cadence moyenne du signal d'horloge de transmission en réponse au signal d'indication d'état provenant de la mémoire FIFO afin de la garder à moitié pleine.

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