G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 5/01 (2006.01)
Patent
CA 2205830
The processor (109) includes a decoder (202) being coupled to receive a control signal (207). The control signal has a first source address, a second source address, a destination address, and an operation field. The first source address corresponds to a first location. The second source address corresponds to a second location. The destination address corresponds to a third location. The operation field indicates that a type of packed data shift operation is to be performed. The processor further includes a circuit (203) being coupled to the decoder. The circuit is for shifting a first packed data being stored at the first location by a value being stored at the second location. The circuit is further for communicating a corresponding result packed data to the third location.
Un processeur (109) comprend un décodeur (202) raccordé de façon à recevoir un signal de commande (207). Le signal de commande possède une première adresse source, une seconde adresse source, une adresse de destination et une zone d'opération. La première adresse source correspond à un premier emplacement. La seconde adresse source correspond à un deuxième emplacement. L'adresse de destination correspond à un troisième emplacement. La zone d'opération indique qu'un type d'opération de décalage de paquets de données doit être effectué. Le processeur comprend également un circuit (203) couplé au décodeur. Le circuit est destiné à décaler un premier paquet de données à mettre en mémoire au niveau du premier emplacement à l'aide d'une valeur mise en mémoire au niveau du deuxième emplacement. Le circuit sert également à transmettre un paquet de données obtenu correspondant dans le troisième emplacement.
Eitan Benny
Menneneier Larry M.
Mittal Millind
Peleg Alexander
Yaari Yaakov
Intel Corporation
Riches Mckenzie & Herbert Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1615397