G - Physics – 01 – R
Patent
G - Physics
01
R
G01R 31/3185 (2006.01) G01R 31/317 (2006.01) G06F 11/26 (2006.01)
Patent
CA 2353950
An integrated circuit is described as comprising a plurality of logic elements (LEs), each of which having a plurality of outputs, and a partial scan register. The plurality of LEs are operative to generate a plurality of output signals in response to a plurality of input signals correspondingly applied to the LEs. The partial scan register is reconfigurably coupled to select ones of the LEs such that, when enabled, the partial scan register is operative to capture and output on a scan bus a record of signal state values of circuit elements emulated by the selected LEs in a particular clock cycle of an operating clock, wherein the partial scan register is enabled with application of a scan clock appropriately scaled to the operating clock.
Circuit intégré comportant plusieurs éléments logiques (LE) possédant chacun plusieurs sorties et un registre de balayage partiel. Les LE sont conçus pour générer plusieurs signaux de sortie en réponse à plusieurs signaux d'entrée appliqués en conséquence aux LE. Le registre de balayage partiel est couplé reconfigurable pour sélectionner certains Les, de sorte que, lorsqu'ils sont activés, le registre de balayage partiel soit actif, capture et produise en sortie sur un bus de balayage un enregistrement des valeurs d'état des signaux des éléments de circuit émulés par les LE sélectionnés dans un cycle d'horloge particulier, le registre de balayage partiel étant activé par l'application d'une impulsion d'horloge de balayage en fonction de l'horloge en fonctionnement.
Lepape Olivier
Reblewski Frederic
Mentor Graphics Corporation
Riches Mckenzie & Herbert Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1450307