H - Electricity – 03 – M
Patent
H - Electricity
03
M
H03M 3/02 (2006.01)
Patent
CA 2303279
A bandpass .SIGMA..DELTA. ADC utilises either a single-loop (10) or a MASH architecture (12, 100, 121). Resonators are implemented as either a delay cell resonator (131), a lossless discrete integrator resonator (132), a Forward- Euler resonator (133), or a two-path interleaved resonator (134). The resonator can be synthesized with analog circuit techniques such as active-RC, gm-C, MOSFET-C, switched capacitor, or switched current. The switched capacitor or switched current circuits can be designed using single-sampling, double-sampling, or multi-sampling circuits. The non-stringent requirement of a .SIGMA..DELTA. ADC using switched capacitor circuits allows the ADC to be implemented in a CMOS process to minimize cost and reduce power consumption. Double-sampling circuits (101) provide improved matching and improved tolerance to sampling clock jitter. In particular, a bandpass MASH 4-4 .SIGMA..DELTA. ADC provides a simulated signal-to-noise ratio of 85dB at an oversampling ratio of 32 for a CDMA application. The bandpass .SIGMA..DELTA. ADC canalso be used in conjunction with undersampling to provide a frequency downconversion.
L'invention concerne un numériseur à bande passante en sigma delta utilisant soit une architecture à boucle unique (10) soit une architecture MASH (12, 100, 121). Des résonateurs servent de résonateur à cellule de retard (131), de résonateur à intégrateur discret sans perte (132), de résonateur Forward-Euler (133), ou de résonateur à deux voies entrelacées (134). Le résonateur peut être réalisé à l'aide de techniques de circuits analogiques telles que, RC actif, gm-C, MOSFET-C, condensateur commuté ou à courant commuté. Les circuits à condensateur commuté ou à courant commuté peuvent être conçus en utilisant des circuits à échantillonnage unique, à double échantillonnage, ou à échantillonnage multiple. Le faible niveau d'exigence d'un numériseur à bande passante en sigma delta utilisant des circuits à condensateur commuté permet audit numériseur d'être mis en oeuvre dans un dispositif CMOS de manière à réduire les coûts à leur minimum et à réduire la consommation d'énergie. Des circuits (101) à double échantillonnage permettent une meilleure adéquation et présentent une tolérance accrue aux sauts de synchronisation d'échantillonnage. En particulier, un numériseur à bande passante MASH 4-4 en sigma delta offre un rapport signal/bruit simulé de 85 dB à une fréquence de suréchantillonnage de 32 pour une application CDMA. Le numériseur à bande passante en sigma delta peut également être utilisé en association avec un sous-échantillonnage de manière à permettre un abaissement de fréquence.
Bazarjani Seyfollah S.
Younis Saed G.
Qualcomm Incorporated
Smart & Biggar
LandOfFree
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