Analog multiplier using multitail cell

Details Analog multiplier using multitail cell Analog multiplier using multitail cell

G - Physics

06

G

G06G 7/16 (2006.01) G06G 7/163 (2006.01)

Patent

CA 2144240

A two-quadrant multiplier for multiplying first and second signals, which can realize wider input voltage ranges than those of the prior-art ones at a low supply voltage such as 3 or 3.3 V. The multiplier has a multitail cell. This multitail cell contains a pair of first and second transistors having differential input ends and differential output ends, a third transistor having an input end, and a constant current source for driving the pair and the third transistor. The first signal is applied across the differential input ends of the pair, and the second signal is applied in a positive or negative phase to the input end of the third transistor. An output signal of the multiplier as a multiplication result of the first and second signals is differentially derived from the differential output ends of the pair. At least one additional transistor may be provided, an input end of which is coupled with the input ends of the third transistor to be applied with the second signal. Two such the multitail cells may be combined to form a four-quadrant multiplier for the first and second signals.

Multiplicateur à deux quadrants pour multiplier un premier et un deuxième signaux, capable de réaliser une plage de tensions d'entrée plus large que dans les modèles antérieurs avec une faible tension d'alimentation, p. ex. de 3 à 3,3 V. Il comprend une cellule multitransistors. Celle-ci contient une paire de transistors à entrées différentielles et sorties différentielles, un troisième transistor ayant une entrée et une source de courant constant pour commander la paire et le troisième transistor. Le premier signal est appliqué aux entrées différentielles de la paire, et le deuxième signal est appliqué en phase positive ou négative à l'entrée du troisième transistor. Un signal de sortie du multiplicateur, résultat de la multiplication des premier et deuxième signaux, est obtenu différentiellement des sorties différentielles de la paire. Il peut y avoir au moins un transistor supplémentaire, dont une entrée est couplée aux entrées du troisième transistor qui recevront le deuxième signal. Deux cellules multitransistors peuvent être combinées afin de former un multiplicateur à quatre quadrants pour les premier et deuxième signaux.

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