Apparatus and method for clock alignment and switching

Details Apparatus and method for clock alignment and switching Apparatus and method for clock alignment and switching

H - Electricity

04

L

H04L 7/00 (2006.01) G06F 1/12 (2006.01) G06F 11/16 (2006.01) H03L 7/081 (2006.01) H04J 3/06 (2006.01)

Patent

CA 2193207

In a telecommunication system (figure 1) having multiple timing subsystems (14, 16 and 18) receiving and distributing redundant timing signals, there is provided a circuitry for aligning first and second redundant timing signals (CLOCK A and CLOCK B) and switching therebetween. The circuitry includes a selecting and switching circuitry for receiving the first and second redundant timing signals (CLOCK A and CLOCK B) and designating one of the redundant timing signals as ACTIVE and the other as INACTIVE, and providing the ACTIVE timing signal as an output timing reference signal. The selecting and switching circuitry further switching the ACTIVE and INACTIVE timing signal designation and output timing reference signal in response to detecting fault or a clock switching command. The ACTIVE timing signal is provided to a first delay path (DELAY PATH A) having a programmable delay value, which delays it and produces a first output timing signal. A second delay path (DELAY PATH B) receives the INACTIVE redundant timing signal and produces a second output timing signal. The circuitry further includes a phase detector (50) which receives the ACTIVE and INACTIVE output timing signals and generates a status signal indicative of the phase relationship therebetween.

Un système de télécommunication (figure 1) comportant plusieurs sous-systèmes de synchronisation (14, 16 et 18) recevant et distribuant des signaux de synchronisation redondants est muni de circuits qui permettent d'aligner les premier et second signaux de synchronisation redondants (HORLOGE A et HORLOGE B) et d'assurer la commutation entre les deux. Les circuits comportent un circuit de sélection et de commutation (la figure) conçus pour recevoir les premier et second signaux de synchronisation redondants (HORLOGE A et HORLOGE B), de désigner l'un des signaux de synchronisation redondants comme ACTIF et comme INACTIF, et de faire du signal de synchronisation ACTIF un signal de référence de synchronisation de sortie, donc le circuit de sélection de commutation commutant également la désignation des signaux de synchronisation ACTIF et INACTIF et le signal de référence de synchronisation de sortie en réponse à la détection d'une erreur ou d'une commande de commutation d'horloge. Le signal de synchronisation ACTIF est envoyé à un premier trajet de temporisation (TRAJET DE TEMPORISATION A) présentant une valeur de temporisation programmable, qui retarde et produit un premier signal de synchronisation de sortie. Un deuxième trajet de temporisation (TRAJET DE TEMPORISATION B) reçoit le signal de synchronisation redondant INACTIF et produit un second signal de synchronisation de sortie. Les circuits comportent également un détecteur de phase (50) qui reçoit les signaux de synchronisation de sortie ACTIF et INACTIF et produit un signal d'état indiquant la relation de phase existant entre les deux.

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