H - Electricity – 03 – M
Patent
H - Electricity
03
M
H03M 7/00 (2006.01) H03M 13/41 (2006.01) H03M 13/12 (1995.01)
Patent
CA 2134996
A digital data processing apparatus capable of reducing a circuit scale without deteriorating error-correcting capability, and capable of reducing the bit number of a branch metric calculating circuit. The apparatus includes: a region determining portion which determines an optimal bit number corresponding to the number of representative symbol groups; a delaying portion which delays an output from the region determining portion for as long as a coded bit is decoded by a Viterbi decoding portion; and a decoding portion which inputs and decodes an output from the delaying portion and a coded bit that is decoded by the Viterbi decoding portion so as to be decoded, and which outputs the uncoded bit.
L'invention est un appareil de traitement de données numériques qui peut réduire l'échelle d'un circuit sans dégrader ses capacités en matière de correction des erreurs et qui peut réduire le nombre de bits utilisé par un circuit de calcul de métriques de branchement. Cet appareil comprend les éléments suivants : une unité de localisation de régions qui détermine le nombre de bits optimal correspondant au nombre de groupes de symboles représentatifs; une unité de retardement qui retarde le signal de sortie de l'unité de localisation de régions durant le décodage d'un bit par une unité de décodage de Viterbi; et une unité de décodage qui saisit le signal de sortie de l'unité de retardement et le décode, et qui saisit également un bit codé pour lui faire subir un décodage de Viterbi et produire un bit décodé.
Kabushiki Kaisha Toshiba
Marks & Clerk
LandOfFree
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