Asynchronous jitter reduction technique

Details Asynchronous jitter reduction technique Asynchronous jitter reduction technique

G - Physics

11

C

G11C 7/22 (2006.01) G11C 8/18 (2006.01)

Patent

CA 2520139

The amount of jitter incurred when reading data written into a FIFO (12) can be reduced by clocking the FIFO with Read Clock pulses at a frequency x fn where x is a whole integer and fn is the frequency at which the memory is clocked to write data. Read Addresses are applied to the FIFO at a frequency on the order of fn to identify successive locations in the memory for reading when the memory is clocked with read clocked pulses to enable reading of samples stored at such successive locations. The duration of at least one successive Read Addresses is altered in response to memory usage status to maintain memory capacity below a prescribed threshold.

Selon l'invention, l'ampleur de la gigue qui apparaît à la lecture de données inscrites dans une mémoire de type FIFO (fisrt in first out / premier entré, premier sorti) (12) peut être réduite en appliquant à la mémoire FIFO des impulsions d'horloge de lecture à une fréquence x f¿n? où x est un entier et f¿n? représente la fréquence d'horloge d'écriture de données dans la mémoire. Des adresses de lecture sont appliquées à la mémoire FIFO à une fréquence de l'ordre de f¿n? pour identifier des emplacements de lecture successifs dans la mémoire lorsqu'on applique à celle-ci des impulsions d'horloge de lecture pour permettre la lecture d'échantillons enregistrés en ces emplacements successifs. La durée de la/des adresse(s) de lecture successive(s) est modifiée en réponse à un statut d'utilisation de mémoire afin de maintenir la capacité de la mémoire à une valeur inférieure à une valeur seuil prédéfinie.

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