Clock generation circuit for multistandard serial digital...

H - Electricity – 04 – N

Patent

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Details

H04N 5/067 (2006.01) H03L 7/095 (2006.01) H04N 5/46 (2006.01) H04N 7/01 (2006.01) H04N 7/56 (2006.01) H04N 11/04 (2006.01)

Patent

CA 2063837

A voltage controlled reference oscillator (20) with a high Q and narrow tunability bandwidth produces an output oscillator frequency which is frequency divided (18) by four alternative constants to produce four different clock frequencies for four different digital video standards, D1 component at 270 MHz, NTSC D2 composite at 143 MHz, PAL D2 composite at 177 MHz, and a proposed new composite video standard that is to operate at a 360 MHz clock rate. Automatic identification of which serial digital video is present is accomplished by having the clock generator (20,18) produce a clock signal at the frequency required by one of the video formats while a phase lock loop (90,26) attempts to lock onto the incoming signals at that frequency. If no lock occurs within a predetermined time interval, the clock generator (20,18) is made to produce a clock signal at the frequency required by a different one of the video formats and the phase lock (90,26) is attempted again. This is repeated until a lock is attained. Optionally, when a lock occurs, the video is tested (80) for validity within the format that is consistent with the clock frequency that produced the lock.

Oscillateur de référence à tension variable (20) présentant une largeur de bande d'accordabilité étroite et de facteur Q élevé. Cet oscillateur produit une fréquence de sortie répartie en fréquence (18) selon quatre constantes possibles qui produisent quatre différentes fréquences d'horloge pour quatre différentes normes de vidéo numérique : une composante D1 à 270 MHz, une composante NTSC D2 à 143 MHz, une composante PAL D2 à 177 MHz et une nouvelle norme de vidéo composite qui doit fonctionner à la fréquence d'horloge de 360 MHz. Pour déterminer automatiquement quelles sont les vidéos numériques en série présentes, le générateur d'horloge (20, 18) produit un signal d'horloge à la fréquence demandée par l'un des formats vidéo pendant qu'une boucle à phase asservie (90, 26) tente de se verrouiller sur l'un des signaux reçus à cette fréquence. Si cette tentative échoue au cours d'un intervalle de temps prédéterminé, le générateur d'horloge (20, 18) produit un signal d'horloge à la fréquence demandée par un autre des formats vidéo et l'on tente de nouveau d'asservir la phase (90, 26). Cette opération est répétée jusqu'à ce qu'un asservissement de la phase ait lieu. Facultativement, lorsqu'un tel asservissement se produit, on peut faire l'essai (80) de la vidéo en ce qui a trait au format correspondant à la fréquence d'horloge ayant produit l'asservissement de phase en question.

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