Compensated phase locked loop for generating a controlled...

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H - Electricity

03

L

H03L 7/183 (2006.01)

Patent

CA 2198101

A method and apparatus for generating a controlled output clock signal (PCLK) which is frequency and phase referenced to an input signal is disclosed. The compensation is programmable to allow an external source, such as a processor, to download a compensation factor to create a variable frequency phase locked loop. A separated programmable divider (78') is downloaded with a complementary value to adjust the varied frequency signal to the frequency of the input signal, supplied to the phase locked loop. This allows the phase locked loop to be varied about a wide range of frequencies without having to adjust the controlled oscillator (66') and the loop filter (64'). The method and phase locked loop disclosed are particularly directed to the generation of selected pixel clocks within a computer printing system.

L'invention concerne un procédé et un dispositif servant à générer un signal d'horloge de sortie régulée (PCLK), dont la phase et la fréquence se réfèrent à celles d'un signal d'entrée. La compensation est programmable, afin de permettre à une source extérieure, telle qu'un processeur, de transférer un facteur de compensation, de manière à créer une boucle à phase asservie à fréquence variable. Un diviseur séparé programmable (78') est transféré avec une valeur complémentaire, afin de régler le signal de fréquence variable sur la fréquence du signal d'entrée alimentant la boucle à phase asservie. Ceci permet à la boucle à phase asservie de varier sur une plage importante de fréquences sans qu'il soit nécessaire de régler l'oscillateur asservi (66') et le filtre de boucle (64'). Ce procédé et cette boucle à phase asservie permettent particulièrement de produire des horloges de pixels sélectionnées dans un système d'imprimante informatique.

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