Controlled-precision iterative arithmetic logic unit

G - Physics – 06 – F

Patent

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G06F 7/499 (2006.01) G06F 7/483 (2006.01)

Patent

CA 2649857

A controlled-precision Iterative Arithmetic Logic Unit (IALU) included in a processor produces sub-precision results, i.e. results having a bit precision less than full precision. In one embodiment, the controlled-precision IALU comprises an arithmetic logic circuit and a precision control circuit. The arithmetic logic circuit is configured to iteratively process operands of a first bit precision to obtain a result. The precision control circuit is configured to end the iterative operand processing when the result achieves a programmed second bit precision less than the first bit precision. In one embodiment, the precision control circuit causes the arithmetic logic circuit to end the iterative operand processing in response to an indicator received by the control circuit. The controlled-precision IALU further comprises rounding logic configured to round the sub-precision result.

Selon l'invention, une unité logique arithmétique itérative (IALU) à précision contrôlée incluse dans un processeur produit des résultats de précision inférieure., c.-à-d., des résultats présentant une précision binaire inférieure à une précision absolue. Dans un mode de réalisation, l'IALU à précision contrôlée comprend un circuit logique arithmétique et un circuit de contrôle de précision. Le circuit logique arithmétique est conçu pour traiter de manière itérative des opérandes d'une première précision binaire afin d'obtenir un résultat. Le circuit de commande de précision est conçu pour mettre fin au traitement d'opérandes itératif lorsque le résultat atteint une seconde précision binaire programmée inférieure à la première précision binaire. Dans un mode de réalisation, le circuit de contrôle de précision amène le circuit logique arithmétique à mettre fin au traitement d'opérandes en réponse à un indicateur reçu par le circuit de contrôle. L'IALU de précision commandée comprend également une logique d'arrondissement conçue pour arrondir le résultat de précision inférieure.

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