Counting circuit

H - Electricity – 03 – K

Patent

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Details

H03K 21/00 (2006.01)

Patent

CA 2245914

Quality requirements on a counter may set a limit to the highest frequency that can be applied to the counter. This will also limit the resolution. According to the invention there is provided a counter comprising a generator for generating, in response to a first clock frequency, M second clock signals phase shifted with respect to each other and of a second frequency lower than the first frequency, and M secondary counters, each one responsive to a respective one of the M second clock signals for generating a secondary counter signal. The second frequency is adapted to work well in the technology available for realizing the secondary counters, with consideration taken to quality requirements. Furthermore, the counter comprises a summing circuit responsive to the secondary counter signals for generating the resulting counter signal by adding the secondary counter signals such that the counter signal has the same number of bits and the same significance as the secondary counter signals.

Les impératifs de qualité concernant un compteur peuvent imposer une limite à la fréquence la plus élevée pouvant être appliquée à celui-ci. Cette contrainte limite également la résolution. La présente invention prévoit un compteur comprenant un générateur destiné à produire, en réponse à une première fréquence d'horloge, un nombre M de signaux d'horloge d'une deuxième série décalés les uns par rapport aux autres et d'une deuxième fréquence qui est inférieure à la première, et sur un nombre M de compteurs secondaires, réagissant chacun à celui des M signaux d'horloge de la deuxième série qui lui correspond pour produire un signal de comptage secondaire. La deuxième fréquence est conçue pour être compatible avec les techniques permettant de réaliser les compteurs secondaires, compte tenu des impératifs de qualité. Le compteur comprend en outre un circuit additionneur qui réagit aux signaux de comptage secondaires pour produire le signal de comptage résultant en ajoutant les signaux de comptage secondaires de telle sorte que le signal de comptage comporte le même nombre de bits et la même signification que les signaux de comptage secondaires.

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