Data link module for time division multiplexing control systems

G - Physics – 08 – C

Patent

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G08C 15/12 (2006.01) G05B 19/042 (2006.01) H04J 3/06 (2006.01) H04J 3/14 (2006.01) H04L 12/10 (2006.01) H04L 12/40 (2006.01) H04L 12/403 (2006.01)

Patent

CA 2176135

A programmable data link module (32) for use in a time division multiplexing control system (30) having a plurality of modules interconnected by a bus (40) for passing control signals between data link modules on a serial multiplex basis. Each module includes an integrated circuit (80) having signal conditioning circuits (180, 186 and 188) including a programmable hysteresis circuit (126) a power on reset delay circuit (190), a safety input inhibit circuit (220), a clock loss detect circuit (240), a safety output protection circuit (262), a data verifier (260), a polarity selector for a third output terminal (350), an input synchronizer (182 and 184), a combined mode/sync output terminal (110), a multiplex clock output terminal (108), a programmable circuit (232) for accepting programming over the clock bus (44) and data bus (46), input/output word extender circuits (104, 106), a high voltage protection circuit (420) including a transistor (600) and a data bus integrity checker (630).

L'invention concerne un module (32) de liaison de données programmable destiné à un système (30) de commande à multiplexage temporel ayant une pluralité de modules interconnectés par un bus (40) permettant de transmettre des signaux de commande entre les modules de liaison de données en fonction d'un multiplexage sériel. Chaque module comprend un circuit intégré (80) ayant des circuits (180, 186 et 188) de conditionnement des signaux comprenant un circuit d'hystérésis programmable (126), un circuit de temporisation (190) de la remise sous tension, un circuit (220) de protection contre les entrées, un circuit (240) de détection d'une perte du signal d'horloge, un circuit (262) de protection contre les sorties, un vérificateur (260) de données, un sélecteur de polarité pour une troisième borne de sortie (350), un synchroniseur (182 et 184) d'entrée, une borne de sortie combinée mode/synchronisation (110), une borne (108) de sortie pour le signal d'horloge multiplex, un circuit de programmation (232) pour accepter une programmation à travers le bus (44) de signaux d'horloge, un bus (46) de données, des circuits entrée/sortie (104, 106) d'extension des mots, un circuit de protection (420) contre les hautes tensions comprenant un transistor (600) et un vérificateur (630) de l'intégrité du bus des données.

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