G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 13/28 (2006.01) G06F 13/36 (2006.01) G06F 13/40 (2006.01) G06F 11/00 (2006.01)
Patent
CA 2259247
The first bus (11) and the second bus (12) are interconnected via the bus repeater (13) having a buffer memory, with DMA (direct memory access) controllers (22, 27) connected to respective buses (11 and 12). The bus repeater (13) can send DMA requests to the DMA controllers (22, 27), and the CPUs (21, 26) can mask these DMA requests. The DMA controller (22) DMA- transfers data on the bus (11) to and from the buffer memory in the bus repeater (13). The DMA controller (27) DMA-transfers data between the buffer memory and the bus (12). The CPU (21) can mask the DMA request from the bus repeater (13) and directly accesses the buffer to check the DMA function. This facilitates debugging of a system to be DMA-transferred between different buses through the buffer.
Cette invention concerne un dispositif dans lequel un premier bus (11) et un second bus (12) sont interconnectés par un répéteur de bus (13) possédant une mémoire tampon, tandis que des unités de commande d'accès direct en mémoire (DMA) (22, 27) sont connectées aux bus respectifs (11, 12). Le répéteur de bus (13) va envoyer des requêtes DMA aux unités de commande DMA (22, 27), tandis que des UCT (21, 26) vont masquer ces requêtes DMA. L'unité de commande DMA (22) va effectuer un transfert DMA de données sur le bus (11) vers et depuis la mémoire tampon du répéteur de bus (13). L'unité de commande DMA (27) va quant à elle effectuer un transfert DMA de données entre la mémoire tampon et le bus (12). L'UCT (21) va masquer la requête DMA provenant du répéteur de bus (13) et accéder directement à la mémoire tampon afin de vérifier la fonction DMA. Ce procédé permet de faciliter le déverminage d'un système que l'on doit transférer par DMA entre différents bus et par l'intermédiaire de la mémoire tampon.
Gowling Lafleur Henderson Llp
Sony Computer Entertainment Inc.
LandOfFree
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