Digital signal decoding apparatus

H - Electricity – 03 – M

Patent

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Details

H03M 7/40 (2006.01) G06T 9/00 (2006.01) H04N 7/50 (2006.01) H04N 7/52 (2006.01)

Patent

CA 2449924

The present invention relates to a digital signal decoding apparatus for receiving and decoding a compression-coded digital signal received in predetermined units. The apparatus comprises: an arithmetic decoding unit for decoding said compression-coded digital signal received in said predetermined units according to an arithmetic coding process that encodes said compression-coded signal by updating a probability-of-occurrence to be used, wherein said arithmetic decoding unit updates said probability-of-occurrence, and initializes said probability-of-occurrence based on information multiplexed into data constituting a transmission unit, when decoding of said transmission unit is started.

Selon cette invention, dans une syntaxe de train de bits de données vidéo comprimées découpées, autrement dit de données vidéo comprimées présentant une structure en tranches, chacune des données vidéo comprimées découpées comporte une en-tête de tranche de chaque donnée vidéo compressée découpée, laquelle en-tête est chargée de multiplexer : un code de déclenchement de tranche, un drapeau de remise à zéro de registre indiquant s'il convient de remettre à zéro une valeur de registre indiquant l'état du mot de code d'un procédé de codage arithmétique dans l'unité d'émission suivante ; la valeur de registre initiale qui constitue une valeur de registre à ce moment précis de façon qu'elle soit utilisée comme valeur de registre au moment du déclenchement du codage et du décodage arithmétique de l'unité d'émission suivante si le drapeau de remise à zéro de registre indique la mention "ne pas effectuer la remise à zéro".

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