Direct memory access (dma) transfer buffer processor

Details Direct memory access (dma) transfer buffer processor Direct memory access (dma) transfer buffer processor

G - Physics

06

F

G06F 13/00 (2006.01) G06F 13/28 (2006.01)

Patent

CA 2467707

A DMA (Direct Memory Access) Exchange Block (DXB) processor (500, 700)may include a receive processor (500) for writing data from a local memory (125) to a host memory (120) over a bus (115), e.g., a Peripheral Component Interconnect Extended (PCI/X) bus, and a transmit processor (700) for writing data retrieved from the host memory (120) over the bus (115) to the local memory (125). Each processor (135) may include a high priority queue and a normal priority queue. A controlling program (130) generates DXBs, each of which include a tag assigned by the controlling program (130) and memory descriptors corresponding to a direct memory access operation. The memory descriptor may include a host memory descriptor (address/length) and one or more local memory descriptors. The controlling program (130) writes a DXB to one of the queues in a cache line spill operation. The transfer processor may include two channel registers, enabling the processor (135) to perform two PCI/X data transfers simultaneously.

L'invention concerne un processeur d'échange de blocs (DXB) à accès direct en mémoire (DMA), qui peut comprendre un processeur de réception pour écrire des données d'une mémoire locale à une mémoire hôte, par l'intermédiaire d'un bus, p. ex. un bus d'interconnexion de composants périphériques étendue (PCI-X), et un processeur de transmission pour écrire des données extraites de la mémoire hôte dans la mémoire locale, par l'intermédiaire d'un bus. Chaque processeur peut comprendre une file d'attente hautement prioritaire et file d'attente de priorité normale. Un programme de commande génère des DXB comprenant chacun une étiquette attribuée par le programme de commande et des descripteurs de mémoire correspondants à une opération d'accès en mémoire. Le descripteur de mémoire peut comprendre un descripteur de mémoire hôte (adresse/longueur) et un ou plusieurs descripteurs de mémoire locale. Le programme de commande écrit un DXB dans une des files d'attente lors d'une opération de vidage de la ligne de cache. Le processeur de transfert peut comprendre deux registres de voie permettant au processeur d'effectuer simultanément deux transferts de données PCI-X.

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