H - Electricity – 03 – K
Patent
H - Electricity
03
K
H03K 19/096 (2006.01)
Patent
CA 2402194
A domino logic circuit and circuit family is disclosed that has reduced the capacitance on the evaluation node for increased performance. The domino logic circuit preferably includes an inverter, a pre-charge transistor, a logic block, and a pre-charge control transistor. One or both of the clocked transistors of conventional domino logic circuits are removed, and a single clocked transistor that controls the logic state of the output of the inverter is provided. This arrangement reduces or eliminates the series resistance in line with the logic block, reduces or eliminates the capacitance contributed by the clocked pre-charge transistor of conventional domino logic circuits, and reduces the size and thus the capacitance contributed by one or more of the transistor of the inverter.
L'invention concerne une famille de circuits à logique domino et de circuits permettant de réduire la capacité exercée sur le noeud d'évaluation, afin d'améliorer la qualité. De préférence, le circuit à logique domino comprend un inverseur, un transistor à précharge, un bloc logique, et un transistor à commande de précharge. L'un des transistors synchronisés, ou les deux, compris dans les circuits à logique domino classiques sont retirés et un seul transistor synchronisé commandant l'état logique de la sortie de l'inverseur est mis en place. Un tel dispositif permet de réduire ou d'éliminer la résistance en série correspondant le mieux avec le bloc logique; il permet de réduire ou d'éliminer la capacité induite par le transistor de précharge synchronisé des circuits à logique domino classiques; il permet également de réduire la taille, et de ce fait la capacité induite par un ou plusieurs transistors de l'inverseur.
Gowling Lafleur Henderson Llp
Honeywell International Inc.
LandOfFree
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Profile ID: LFCA-PAI-O-1848093