G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/76 (2006.01) G06F 1/00 (2006.01) G06F 9/38 (2006.01) G06F 15/78 (2006.01) G06F 21/00 (2006.01) H04N 5/00 (2006.01)
Patent
CA 2395645
A multiple-mode processing circuit, such as a dual-mode processor (5), operates in at least first and second modes according to a switch (10). When a mode is active, data transfer between the processor and a respective memory occurs. Thus, instructions from the memory can be executed at the processor, and the results can be stored in the respective memory. For example, first and second memories (14, 54) may be provided for the first and second modes (10, 50), respectively. The memories are separate, and no data transfer can occur between the memories directly or via the processor. The first mode (10) may be a secure mode for secure processing operations, such as providing conditional access for television programming services at a set-top subscriber terminal. The second mode (50) may be a non-secure mode, such as for providing any other application at the terminal, e.g., program guide, shop at home service, etc. In one embodiment, a data bus is provided for time-multiplexed transfer of data between the processor and the respective memories. In another embodiment, switching of individual internal registers and external elements such as address and data latches, is provided.
Circuit de traitement multimodal, tel qu'un processeur bimodal (5), fonctionnant selon au moins un premier et un deuxième modes en fonction d'un commutateur (10). Quand un mode est actif, un transfert de données s'effectue entre le processeur et une mémoire respective. Ceci permet d'exécuter au niveau du processeur des instructions provenant de la mémoire et de mémoriser les résultats dans la mémoire respective. Une première et une deuxième mémoires (14, 54) peuvent, par exemple, être associées au premier et au deuxième modes (10, 50) respectifs. Ces mémoires sont séparées et aucun transfert de données ne peut s'effectuer directement entre les mémoires ou par l'intermédiaire du processeur. Le premier mode (10) peut être un mode sécurisé servant à exécuter des opérations de traitement sécurisées, telles qu'un accès conditionnel à des services de programmation de télévision au niveau d'un terminal d'abonné placé sur la télévision. Le deuxième mode (50) peut être un mode non sécurisé, afin, par exemple, d'exécuter toute autre application au niveau du terminal, par exemple, un guide de programme, des achats informatisés, etc. Dans un mode de réalisation, un bus de données sert à effectuer le transfert de données multiplexé dans le temps entre le processeur et les mémoires respectives. Un autre mode de réalisation concerne la commutation de registres internes individuels et d'éléments externes, tels que des verrous d'adresses et de données.
Candelore Brant
Sprunk Eric J.
General Instrument Corporation
Ridout & Maybee Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1932149