Efficient interrupt return address save mechanism

Details Efficient interrupt return address save mechanism Efficient interrupt return address save mechanism

G - Physics

06

F

G06F 9/32 (2006.01) G06F 9/38 (2006.01) G06F 9/42 (2006.01) G06F 9/46 (2006.01) G06F 9/48 (2006.01)

Patent

CA 2657168

A system, apparatus and method for efficiently processing interrupts using general purpose registers in a pipelined processor. In accordance with the present disclosure, a register file may be updated to efficiently save an interrupt return address. When an interrupt request is received by the system's processor, or when the request is issued in the execution of a program, a pseudo-instruction is generated. This pseudo-instruction travels down the pipeline in the same way as other instructions and updates the register file by causing the register file to be written with the return address of the last instruction for which processing has not been completed.

Système, dispositif et procédé permettant de traiter efficacement les interruptions en utilisant des registres universels dans un processeur pipeline. Selon la présente invention, un fichier de registre peut être mis à jour pour sauvegarder efficacement une adresse de retour d'interruption. Lorsqu'une demande d'interruption est reçue par le processeur du système, ou lorsque la demande est émise dans l'exécution d'un programme, une pseudo-instruction est produite. Cette pseudo-instruction descend le long du pipeline de la même façon que les autres instructions et met à jour le fichier de registre en provoquant l'écriture sur le fichier de registre de l'adresse de retour de la dernière instruction pour laquelle le traitement n'a pas été terminé.

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Profile ID: LFCA-PAI-O-1621957