Enhanced texture map data fetching circuit and method

Details Enhanced texture map data fetching circuit and method Enhanced texture map data fetching circuit and method

G - Physics

06

T

G06T 15/10 (2006.01) G06F 12/08 (2006.01) G06T 15/20 (2006.01)

Patent

CA 2275727

A circuit and method for increasing the processing efficiency of texture map data requests within a 3D subunit of a computer controlled graphics display system. The 3D graphics display subsystem includes a polygon engine, a texture map engine and a pixel pipeline. The texture map engine contains a texture map data access (TDA) circuit having a cache controller with a computer readable cache memory for containing recently used texture maps stored in (u, v) coordinate space. The cache controller is limited in handling only n cache miss operations simultaneously. In one embodiment, n is 1. The TDA circuit also contains a texture map address (TMA) FIFO memory unit for storing texture map addresses associated with texture data requests that hit or missed in the cache memory unit. Since the cache controller handles up to n misses, the texture engine stalls when the (n+1)th unprocessed texture request miss is encountered. Therefore, the TMA FIFO at any time contains at most n miss addresses therein. Processing efficiency is increased when a miss is encountered but the TMA FIFO contains unprocessed hit addresses. At this time, simultaneously with the cache controller fetching the texture data for the missed address, it can also advantageously: (1) supply data from the cache memory for the previously encountered and stored hit addresses; and (2) accept new hit addresses into the TMA FIFO thereby effectively avoiding a texture engine stall. This is quite unlike the prior art systems which process no hit addresses upon a texture miss but rather stall the texture engine.

Circuit et procédé servant à améliorer l'efficacité de traitement de demandes de données de texturage à l'intérieur d'une sous-unité tridimensionnelle d'un système d'affichage graphique commandé par ordinateur. Ce sous-système d'affichage graphique tridimensionnel comprend un moteur de polygone, un moteur de texturage et un pipeline de pixels. Le moteur de texturage contient un circuit d'accès à des données de texturage (TDA) possédant un contrôleur d'antémémoire comportant une antémémoire lisible par ordinateur servant à contenir des texturages récemment utilisés et mémorisés dans un espace de coordonnées (u, v). Le contrôleur d'antémémoire ne peut traiter simultanément que n opérations manquées dans l'antémémoire. Dans un mode de réalisation, n est 1. Le circuit TDA contient également une unité de mémoire FIFO d'adresses de texturage (TMA) servant à mémoriser les adresses de texturage associées aux demandes de données de texturage réussies ou non dans l'antémémoire. Etant donné que le contrôleur d'antémémoire traite n insuccès maximum, le moteur de texturage s'arrête à l'apparition du (n+1)ème insuccès non traité de demande de texturage. Par conséquent, la mémoire FIFO de TMA ne contient à tout moment que n adresses réussies au maximum. L'efficacité de traitement est améliorée dans le cas d'un insuccès mais la mémoire FIFO de TMA contient des adresses réussies non traitées. A ce moment, simultanément à la recherche des données de texture pour l'adresse non réussie par le contrôleur d'antémémoire, il peut également et de façon avantageuse; (1) extraire des données de l'antémémoire pour les adresses réussies déjà rencontrées et mémorisées; (2) introduire de nouvelles adresses réussies dans la mémoire FIFO de TMA, ce qui permet d'éviter l'arrêt du moteur de texturage. Ceci n'est pas le cas dans les systèmes de l'état actuel de la technique qui ne traitent aucune adresse réussie lors d'un échec de texture mais arrêtent le moteur de texturage.

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