H - Electricity – 04 – L
Patent
H - Electricity
04
L
H04L 12/56 (2006.01) H04Q 11/04 (2006.01)
Patent
CA 2217586
This invention provides a fast framing device that processes a stream of bytes and generates a signal for every byte clock that indicates whether a selected Asychronous Transfer mode cell boundary may be valid. The fast framing device generates a Cyclical Redundancy Code (CRC) corresponding to each byte from a input byte stream. The generated CRC is processed by an XOR tree that produces an output equivalent to processing the CRC code through five cycles of an CRC generator. The result of the XOR tree is exclusive with a hexidecimal number "AC" or 0xAC. The result of the XOR tree and the XOR gate is delayed by five cycles and then compared with the CRC generated during the fifth byte clock. The compared results indicates whether the prior five bytes may be a valid ATM cell header.
Dispositif de formation rapide de trames permettant de traiter un train de multiplets et de produire pour chaque impulsion de synchronisation de multiplets un signal qui indique si une frontière de cellule ATM (mode de transfert asynchrone) sélectionnée peut être valide. Le dispositif génère un code de redondance cyclique (CRC) correspondant à chaque multiplet d'un train de multiplets d'entrée. Le CRC généré est traité par un arbre OU exclusif qui produit une sortie équivalant au traitement du code CRC par cinq cycles d'un générateur de CRC. Le résultat de l'arbre OU exclusif est mis en fonction OU exclusif avec un nombre hexadécimal « AC » ou 0xAC. Le résultat de l'arbre OU exclusif et de la porte OU exclusif est retardé de cinq cycles puis comparé avec le CRC généré pendant la cinquième impulsion de synchronisation de multiplets. Les résultats comparés indiquent si les cinq multiplets antérieurs peuvent constituer un en-tête de cellule ATM valide.
At&t Corp.
Kirby Eades Gale Baker
LandOfFree
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Profile ID: LFCA-PAI-O-1751072