Gatable-level-pulling circuit

H - Electricity – 03 – K

Patent

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Details

H03K 19/0175 (2006.01) H03K 17/30 (2006.01) H03K 19/173 (2006.01)

Patent

CA 2227254

Integrated circuit components automatically establish or disable a level- pulling condition relative to a given input IC pin (22) as a function of detected signal activity at such IC pin. A logic signal responsive to signal activity at the IC pin drives the gate (32a) of a field effect transistor (FET 32) to dynamically establish or disable level-pulling function at the IC pin. Alternative embodiments include a flip-flop register (40) and an OR gate (60, Fig. 3) driving the gate of the FET.

Des composants de circuits intégrés activent ou inactivent automatiquement une fonction de retour à un niveau par rapport à une broche d'entrée donnée d'un circuit intégré en fonction de l'activité d'un signal détecté à une telle broche de circuit intégré. Un signal logique réagissant à l'activité du signal à la broche du circuit intégré commande la grille d'un transistor à effet de champ pour activer ou désactiver dynamiquement la fonction de retour à un niveau à la broche du circuit intégré. Comme autres formes d'exécution, on peut citer un registre flip-flop et une porte OU commandant la grille du transistor à effet de champ.

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