High speed signaling for interfacing vlsi cmos circuits

Details High speed signaling for interfacing vlsi cmos circuits High speed signaling for interfacing vlsi cmos circuits

H - Electricity

03

K

H03K 5/1534 (2006.01) H03H 11/02 (2006.01) H03K 19/0185 (2006.01) H03M 9/00 (2006.01)

Patent

CA 2323446

A system of the present invention uses small swing differential source synchronous voltage and timing reference (SSVTR and /SSVTR) signals to compare single-ended signals of the same slew rate generated at the same time from the same integrated circuit for high frequency signaling. The SSVTR and /SSVTR signals toggle every time the valid signals are driven by the transmitting integrated circuit. Each signal receiver includes two comparators, one for comparing the signal against SSVTR and the other for comparing the signal against /SSVTR. A present signal binary value determines which comparator is coupled to the receiver output, optionally by using XOR logic with SSVTR and /SSVTR. The coupled comparator in the receiver detects whether change in signal binary value occurred or not until SSVTR and /SSVTR have changed their binary value. The same comparator is coupled if the signal transitions. The comparator is de-coupled if no transition occurs. The system may use a first set of oscillating references on a first bus for detecting transitions in control information and a second set of oscillating references for detecting transitions in data information.

Dans le dispositif de la présente invention, on utilise des signaux de base de temps et de tension synchrone différentielle, à faible excursion, de source oscillante (SSVTR et /SSVTR) afin de comparer, pour une signalisation haute fréquence, des signaux à sortie unique à vitesse de balayage identique, générée simultanément par le même circuit intégré. Le signaux SSVTR et /SSVTR basculent à chaque fois que les signaux valides sont pilotés par le circuit intégré émetteur. Chaque récepteur de signal comprend deux comparateurs, le premier destiné à comparer le signal au signal SSVTR et le second destiné à le comparer au signal /SSVTR. Une valeur binaire actuelle du signal détermine lequel des comparateurs est couplé à la sortie du récepteur, en utilisant éventuellement la logique du OU exclusif avec SSVTR et /SSVTR. Le comparateur couplé détecte si un changement de la valeur binaire du signal a lieu ou n'a pas lieu, jusqu'à ce que les signaux SSVTR et /SSVTR aient changé leur valeur binaire. Ce comparateur est couplé si le signal change d'état; il est découplé en l'absence de transition. Le dispositif peut utiliser un premier ensemble de références oscillantes sur un premier bus afin de détecter des transitions dans l'information de contrôle et un second ensemble de références oscillantes afin de détecter des transitions dans l'information de données.

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