G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 13/42 (2006.01)
Patent
CA 2336385
An inter-device serial bus protocol facilitates the interconnection and communication among various devices via a serial bus. The bus (48) comprises a clock wire, a data wire, and a start/stop wire. A master serial bus interface couples a master device to the serial bus. A slave serial bus interface couples a slave device to the serial bus. The master serial bus interface (180) may comprise a transaction initiator, a data write mechanism, a data read mechanism, and a clock driver. The transaction initiator initiates a transaction by pulling the signal level of the start/stop wire low. The data write mechanism controls the signal level on the data wire in accordance with the data to be written to the slave device. The data read mechanism reads data by monitoring the signal level on the data wire. The clock driver controls the signal level on the clock wire in accordance with a desired clock signal.
L'invention concerne un protocole de bus en série entre dispositifs qui facilite l'interconnexion et la communication entre plusieurs dispositifs via un bus en série. Le bus (48) comprend une connexion d'horloge, une connexion de données et une connexion marche/arrêt. Une interface de bus en série principale raccorde un dispositif principal au bus en série. Une interface de bus en série asservie raccorde un dispositif asservi au bus en série. L'interface (180) de bus en série principale peut comprendre un initiateur de transaction, un mécanisme d'écriture de données, un mécanisme de lecture de données et une commande d'horloge. L'initiateur de transaction initie une transaction en abaissant le niveau du signal de la connexion marche/arrêt. Le mécanisme d'écriture de données commande le niveau du signal dans la connexion de données en fonction des données à inscrire dans le dispositif asservi. Le mécanisme de lecture de données lit des données en contrôlant le niveau de signal dans la connexion de données. La commande d'horloge commande le niveau de signal dans la connexion d'horloge en fonction d'un signal d'horloge voulu.
Jha Sanjay K.
Qualcomm Incorporated
Smart & Biggar
LandOfFree
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Profile ID: LFCA-PAI-O-1599814