G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 9/38 (2006.01) G06F 7/38 (2006.01) G06F 9/312 (2006.01) G06F 9/345 (2006.01) G06F 15/00 (2006.01)
Patent
CA 2503079
A system and method is provided for improving throughput of an in-order multithreading processor. A dependent instruction is identified to follow at least one long latency instruction with register dependencies from a first thread. The dependent instruction is recycled by providing it to an earlier pipeline stage. The dependent instruction is delayed at dispatch. The completion of the long latency instruction is detected from the first thread. An alternate thread is allowed to issue one or more instructions while the long latency instruction is being executed.
L'invention concerne un système et une méthode destinés à améliorer la sortie d'un processeur multichaîné symétrique. Une instruction dépendante est censée suivre au moins une longue instruction de latence avec des dépendances de registre d'un premier chemin. L'instruction dépendante est réutilisée par renvoi à une étape pipeline antérieure. L'instruction dépendante est retardée lors de la répartition. L'achèvement de l'instruction à longue latence est détecté à partir du premier chemin. Un autre chemin peut délivrer un ou plusieurs instructions tandis que l'instruction de latence longue est exécutée.
Feiste Kurt Alan
Shippy David
Van Norstrand Albert James Jr.
International Business Machines Corporation
Wang Peter
LandOfFree
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Profile ID: LFCA-PAI-O-1434693