G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 3/00 (2006.01) G06F 12/06 (2006.01)
Patent
CA 2186334
A processing system including a processor and a peripheral wherein a configuration input of an address decoder or a device address input of a peripheral device which is not needed to set the peripheral's device address is used to increase the input capability of the processor. A data input signal is coupled to the configuration input or to the device address input such that the peripheral has a plurality of possible device addresses dependent on the state of the data input signal. The processor is configured to attempt communication with the peripheral by checking the plurality of possible device addresses of the peripheral until the peripheral gives a response to the processor. The device address to which the peripheral responds represents the state of the data input signal.
L'invention est constituée par un système de traitement qui comporte un processeur et un périphérique et dans lequel une entrée de configuration d'un décodeur d'adresses ou une entrée d'adresses d'un périphérique non nécessaire pour sélectionner son adresse est utilisée pour accroître la capacité d'entrée du processeur. Un signal de données est transmis à l'entrée de configuration ou à l'entrée d'adresses de dispositif de telle façon que le périphérique ait un choix d'adresses de dispositif qui dépendent de l'état du signal de données. Le processeur est configuré de façon à tenter de communiquer avec le périphérique en vérifiant la pluralité des adresses de dispositif possibles du périphérique jusqu'à ce que ce dernier réponde au processeur. L'adresse de dispositif à laquelle le périphérique répond représente l'état du signal de données.
Bereskin & Parr
Paragon Electric Company Inc.
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