H - Electricity – 04 – B
Patent
H - Electricity
04
B
H04B 1/707 (2006.01)
Patent
CA 2509161
A spread spectrum digital communication receiver, of the type comprising an input memory buffer (16) for storing samples of an input signal (y(k)) and a code generator circuit (30) for generating a re-generated user code, incorporates a device (24) for the estimation of a channel delay profile comprises: a basic correlator (32) having a first input (41) for sequentially reading from a memory location of the input memory buffer (16) a plurality of samples of the input signal (y(k)), a second input (43) for receiving from the code generator circuit (30) a re-generated user code, and an output terminal for generating, by means of a correlation operation between the plurality of samples of the input signal and the regenerated user code, a first value of the channel delay profile energy (DP(1)); and a memory controller circuit (36) for addressing said the memory buffer (16) so that the first input (41) of the basic correlator (32) is successively fed with the content of several memory locations of the memory buffer (16), each addressing operation corresponding to a new correlation operation of the basic correlator (32) for the computation of a new value of the channel delay profile energy (DP(l)).
L'invention concerne un récepteur de communication numérique à spectre étalé, du type comprenant une mémoire tampon d'entrée (16), dans laquelle sont stockées des échantillons d'un signal d'entrée (y(k)), et un circuit générateur de code (30) qui sert à générer un code utilisateur régénéré. Ce récepteur comprend un dispositif (24) servant à l'estimation d'un profil de retard de canal comportant: un corrélateur basique (32) présentant une première entrée (41), servant à la lecture séquentielle, à partir d'un emplacement de la mémoire tampon d'entrée (16), d'une pluralité d'échantillons du signal d'entrée (y(k)), une seconde entrée (43), servant à la réception du code utilisateur régénéré en provenance du circuit générateur de code (30), et un terminal de sortie, servant à générer, par une opération de corrélation entre la pluralité d'échantillons du signal d'entrée et au moyen du code d'utilisateur régénéré, une première valeur de l'énergie de profil de retard de canal (DP(I)); et un circuit contrôleur de mémoire (36) qui sert à effectuer un adressage de ladite mémoire tampon (16) de sorte que la première entrée (41) du corrélateur basique (32) reçoive successivement le contenu de plusieurs emplacements de mémoire de la mémoire tampon (16), chaque opération d'adressage correspondant à une nouvelle opération de corrélation du corrélateur basique (32) pour le calcul d'une nouvelle valeur de l'énergie de profil de retard de canal (DP(l)).
Ettorre Donato
Finotello Andrea
Graziano Maurizio
Melis Bruno
Ossoli Alessandro
Ridout & Maybee Llp
Stmicroelectronics S.r.l.
Telecom Italia S.p.a.
LandOfFree
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