Method and apparatus for clock synchronizing system

H - Electricity – 04 – J

Patent

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Details

H04J 3/06 (2006.01) H04L 7/00 (2006.01) H04L 7/027 (2006.01)

Patent

CA 2110030

A clock synchronizing apparatus for use in a digital automobile telephone apparatus has a receiver, a clock synchronizing circuit, a timing control circuit, a multiplexer/demultiplexer, and a level comparator. The receiver detects the level of an electric field of a received radio wave. The clock synchronizing circuit selectively outputs a phase-corrected clock signal reproduced from the received wave or a free-running clock signal. The level comparator compares the detected level of the electric field with a predetermined threshold and controls the clock synchronizing circuit to select one of the phase-corrected and free-running clock signals in response to the result of comparison. Specifically, the level comparator controls the clock synchronizing circuit to output the phase-corrected clock signal if the detected level of the electric field is in excess of the predetermined threshold, and to output the free-running clock signal if the detected level of the electric field is equal to or less than the predetermined threshold.

L'invention est un dispositif de synchronisation de signaux d'horloge pour téléphone d'automobile numérique qui comprend un récepteur, un circuit de synchronisation de signaux d'horloge, un circuit de temporisation, un multiplexeur-démultiplexeur et un comparateur de niveaux. Le récepteur détecte le niveau du champ électrique d'une onde radio reçue. Le circuit de synchronisation de signaux d'horloge sélectionne un signal d'horloge à phase corrigée obtenu de l'onde reçue ou du signal d'une horloge relaxée. Le comparateur de niveaux compare le niveau détecté du champ électrique avec un seuil prédéterminé et commande au circuit de synchronisation de signaux d'horloge de sélectionner l'un des signaux à phase corrigée de l'horloge relaxée en réponse au résultat de cette comparaison. Plus exactement, le comparateur de niveaux commande au circuit de synchronisation de signaux d'horloge de produire un signal d'horloge à phase corrigée si le niveau détecté du champ électrique est plus élevé que le seuil prédéterminé et de produire le signal de l'horloge relaxée si ce niveau correspond au seuil prédéterminé ou se trouve au-dessous de celui-ci.

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