H - Electricity – 03 – M
Patent
H - Electricity
03
M
H03M 7/00 (2006.01) H04B 7/216 (2006.01) H04J 1/00 (2006.01) H04J 3/00 (2006.01)
Patent
CA 2566263
A method and apparatus (10) for efficiently allocating and deallocating interleaved data stored in a memory stack. The apparatus includes a processor (22) and a memory (12) including at least one memory stack. The processor receives and interleaves a plurality of data blocks. Each data block is allocated for a particular transport channel (TrCH) and has a designated transmission timing interval (TTI). The processor stores the interleaved data blocks in the memory stack based on the TTI of each data block, such that a data block having a larger TTI is allocated to the memory stack earlier and deallocated from the stack later than a data block having a smaller TTI. In one embodiment, the memory includes a first memory stack for common/shared uplink channels, a second memory stack for dedicated uplink channels, a third memory stack for common/shared downlink channels, and a fourth memory stack for dedicated downlink channels.
La présente invention a trait à un procédé et à un appareil permettant d'affecter et de désaffecter efficacement des données entrelacées stockées dans une pile de mémoire. L'appareil selon l'invention comprend un processeur et une mémoire contenant au moins une pile de mémoire. Le processeur reçoit et entrelace une pluralité de blocs de données. Chaque bloc de données est associé à un canal de transport particulier (TrCH), et présente un intervalle de temps de transmission (TTI) désigné. Le processeur stocke les blocs de données entrelacées dans la pile de mémoire sur la base du TTI de chaque bloc de données, de façon qu'un bloc de données présentant un TTI élevé soit affecté à la pile de mémoire avant et désaffecté de ladite pile après un bloc de données présentant un TTI moins élevé. Dans un mode de réalisation, la mémoire comporte une première pile de mémoire pour des canaux sens montant communs/partagés, une deuxième pile de mémoire pour des canaux sens montant spécialisés, une troisième pile de mémoire pour des canaux sens descendant communs/partagés, et une quatrième pile de mémoire pour des canaux sens descendant spécialisés.
Castor Douglas R.
Desai Binish P.
Levi Alan M.
Mcclellan George W.
Interdigital Technology Corporation
Ridout & Maybee Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1902102