G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 12/02 (2006.01) G06F 15/16 (2006.01)
Patent
CA 2081913
Apparatus and method for use in a multi-CPU data processing system (10) wherein each CPU (12-18) is coupled to a common bus (20) and through the common bus to a main memory (28). The method and apparatus provides a program, such as an operating system, that is operating upon each of the CPUs access to a page of data within the main memory. Each of the CPUs generates a first address for identifying a memory location or locations within a page of the main memory. The first address is modified as a function of the first address and as a function of an identification of the CPU to generate a second address for identifying a memory location or locations that are either within the same page or within another page of the main memory. The modified address is applied to the memory for accessing the memory location or locations.
Appareil et procédé destinés à être utilisés dans un système de traitement de données multi-UC (10) dans lequel chaque UC (12 à 18) est couplée à un bus commun (20) et par l'intermédiaire de ce dernier à une mémoire centrale (28). Le procédé et l'appareil comportent un programme, tel qu'un système d'exploitation, fonctionnant sur chacun des accès des UC à une page de données se trouvant dans la mémoire centrale. Chacune des UC produit une première adresse destinée à identifier un emplacement ou des emplacements en mémoire à l'intérieur d'une page de la mémoire centrale. La première adresse est modifiée en fonction de la première adresse et en fonction d'une identification de l'UC afin de produire une seconde adresse destinée à identifier un emplacement ou des emplacements en mémoire se trouvant soit dans la même page soit dans une autre page de la mémoire centrale. L'adresse modifiée est appliquée à la mémoire afin d'accéder à un ou à plusieurs emplacements en mémoire.
Lg Semicon Co. Ltd.
Smart & Biggar
LandOfFree
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Profile ID: LFCA-PAI-O-1896434