G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 9/30 (2006.01) G06F 9/305 (2006.01) G06F 9/32 (2006.01) G06F 9/38 (2006.01) G06F 9/45 (2006.01) G06F 9/46 (2006.01)
Patent
CA 2249356
A method for operating a Reduced Instruction Set Computer, RISC, processor that executes normal RISC instruction and special RISC instructions. The method comprises the steps of controlling the RISC processor to perform a single operation (212), using a single functional unit of the RISC processor, in response to each normal RISC instruction. The method also comprises the step of controlling the RISC processor to perform multiple operations (212), using multiple functional units of the RISC processor in parallel, in response to each special RISC instruction. The method also comprises the step of controlling the RISC processor to repeatedly perform special operations wherein, after a first operation, each subsequent operation depends on a result of a previous operation.
Procédé d'exploitation d'un processeur d'ordinateur à jeu d'instructions réduit (RISC) exécutant une instruction RISC normale et des intructions RISC spéciales. Le procédé comprend les étapes consistant à commander le processeur RISC afin qu'il exécute une seule opération (212) à l'aide d'une seule unité fonctionnelle du processeur RISC, en réponse à chaque instruction RISC normale. Le procédé comprend également l'étape consistant à commander le processeur RISC afin qu'il exécute des opérations multiples (212) à l'aide d'unités fonctionnelles multiples d'un chemin du processeur RISC en parallèle, en réponse à chaque instruction RISC spéciale. Le procécé (165) de données comprend également une étape de commande du processeur RISC destinée à l'exécution itérative d'opérations spéciales, dans laquelle, après chaque première opération, chaque opération suivante dépend du résultat d'une opération précédente.
Peterson James R.
Poole Glenn C.
Sriti Mohammed
Micron Technology Inc.
Riches Mckenzie & Herbert Llp
LandOfFree
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Profile ID: LFCA-PAI-O-1984269