G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 15/16 (2006.01) G06F 12/08 (2006.01)
Patent
CA 2113867
A method and system for the enhanced efficiency of data transfers from memory to multiple processors in a data processing system. Each of the multiple processors has an associated buffer for storing data transferred via a common bus which couples the processors and memory together. Each of the multiple processors continually monitors the common bus and is capable of asserting a selected control signal in response to an attempted activity of another one of the multiple processors which would violate data coherency within the data processing system during a particular period of time following the attempted activity. Data is transferred from memory to a buffer associated with one of the multiple processors and stored in the buffer in response to a request from the processor associated with the buffer prior to expiration of the particular period of time and prior to a determination of whether or not this transfer will result in a possible data coherency problem. The common bus is continually monitored during the particular period of time. Transfer of the data from the buffer to the processor is prohibited in response to a presence on the common bus of the selected control signal prior to expiration of the particular of time. Transfer of the data from the buffer to the processor is permitted in response to an absence on the common bus of the selected control signal.
L'invention est constituée par une méthode et un système servant à accroître l'efficacité des transferts de données entre la mémoire et les multiples processeurs d'un système de traitement de données. € chacun de ces multiples processeurs est associé un tampon servant à stocker les données transférées par un bus commun qui couple les processeurs à la mémoire. Chacun de ces multiples processeurs surveille le bus commun de façon continue et peut valider un signal de commande sélectionné en réponse à une tentative d'action de la part d'un autre des multiples processeurs qui violerait la cohérence des données dans le système de traitement des données durant une période de temps particulière après cette tentative. Les données sont transférées de la mémoire à un tampon associé à l'un des multiples processeurs et stockées dans ce tampon en réponse à une demande transmise par le processeur associé au tampon avant l'expiration de la période de temps en cause et avant que le système n'ait pu déterminer si le transfert produira un problème de cohérence de données. Le bus commun est surveillé de façon continue durant cette période de temps. Le transfert des données du tampon au processeur est bloqué en réponse à la présence sur le bus commun du signal de commande sélectionné avant l'expiration de la période de temps en cause et est autorisé en réponse à l'absence du signal de commande sélectionné sur le bus commun.
Allen Michael Scott
Moore Charles Roberts
Reese Robert James
International Business Machines Corporation
Motorola Inc.
Rosen Arnold
LandOfFree
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Profile ID: LFCA-PAI-O-1964450