Method and system for resistance to statistical power analysis

Details Method and system for resistance to statistical power analysis Method and system for resistance to statistical power analysis

H - Electricity

04

L

H04L 9/06 (2006.01) G06K 19/073 (2006.01) G07F 7/10 (2006.01)

Patent

CA 2397615

New techniques for cracking sealed platforms have recently been discovered which observe power modulation during execution of a software encryption program on a computer processor. Particularly vulnerable to such simple power analysis and differential power analysis attacks are smart cards which employ Data Encryption Standard (DES) protection. The invention protects against such attacks by substantively altering the observable operation of the cryptographic algorithm while it is processing input data. The alterations are generated in a random way and may include average neutral execution, permuted execution or code padding of the cryptographic algorithm.

On a récemment découvert de nouvelles techniques pour craquer des codes de plates-formes protégées qui mettent en oeuvre une observation de modulation de puissance lors de l'exécution d'un logiciel de codage sur un processeur d'ordinateur. Les cartes à puces, qui utilisent une protection de norme de chiffrage des données (DES) sont particulièrement vulnérables à des attaques d'analyses différentielle et simple de puissance. L'invention permet une protection contre de telles attaques par une altération sensible de l'opération d'observation de l'algorithme cryptographique lorsqu'il est entrain de traiter des données d'entrée. Ces altérations sont produites de manière aléatoire et peuvent inclure une exécution neutre de moyenne, une exécution permutée ou un bourrage code de l'algorithme cryptographique.

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