G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 9/06 (2006.01) G06F 9/45 (2006.01) G06F 9/46 (2006.01)
Patent
CA 2617467
A method for multi-platform parallel or real-time machine programming is provided. The method comprises specifying a parallel machine definition code defining a plurality of signal or data processing components and a communication of data or signals between the components, automatically converting the code into computer instructions for execution on an essentially sequential, non-parallel computer processor, a parallel execution of the instructions on the sequential processor and automatically converting the code into hardware programming data for providing parallel hardware operation according to the code, by including, in the hardware programming data, event control circuitry specification, priority control circuitry specification and buffering control circuitry specification to ensure that the hardware operation matches the execution on the sequential computer processor. The parallel machine code is implemented using the hardware programming data on a parallel hardware machine having parallel processing capability and using the computer instructions on the sequential processor in a manner that is essentially exchangeable.
L'invention concerne un procédé de programmation de machine en temps réel ou parallèle multi-plateforme. Ce procédé consiste à spécifier un code de définition de machine parallèle définissant une pluralité de composants de traitement de données ou de signaux et une communication de données ou de signaux entre ces composants, à convertir automatiquement ce code en instructions informatiques pour une exécution sur un processeur informatique non parallèle, essentiellement séquentiel, une exécution en parallèle des instructions sur le processeur séquentiel, et à convertir automatiquement ce code en données de programmation de matériel pour obtenir un fonctionnement de matériel en parallèle selon le code, en incluant, dans ces données de programmation de matériel, une spécification de circuits de commande d'événements, une spécification de circuits de commande de priorités et une spécification de circuits de commande tampon afin de garantir que le fonctionnement du matériel corresponde à l'exécution sur le processeur informatique séquentiel. Le code machine parallèle est implémenté à l'aide des données de programmation de matériel sur une machine de matériel parallèle possédant une capacité de traitement en parallèle et utilisant les instructions informatiques sur le processeur séquentiel d'une manière essentiellement échangeable.
Norton Rose Or S.e.n.c.r.l. S.r.l./llp
Universite Du Quebec A. Chicoutimi
LandOfFree
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Profile ID: LFCA-PAI-O-1524825