G - Physics – 06 – F
Patent
G - Physics
06
F
G06F 21/02 (2006.01) G06F 21/00 (2006.01)
Patent
CA 2733667
The subject of the present invention is a method for detecting anomalies in a circuit protected by differential logic and which processes logic variables represented by a pair of components (a t, a f), a first network of cells (T) carrying out logic functions on the first component of said pairs, a second network of dual cells (F) operating in complementary logic on the second component, the logic functions being carried out by each pair of cells (T, F) in a pre-charge phase (21) placing the variables in a known state on input to the cells and followed by an evaluation phase (22) where a calculation is performed by the cells, said method being characterized in that an anomaly is detected by at least one non-consistent state. The subject of the invention is also a circuit protected by differential logic comprising means for testing the consistency between the two components of the logic variables during the pre-charge or evaluation phases at the monitored nodes of the circuit.
La présente invention a pour objet un procédé de détection d'anomalies dans un circuit protégé par logique différentielle et traitant des variables logiques représentées par un couple de composantes (at, af), un premier réseau de cellules (T) réalisant des fonctions logiques sur la première composante desdits couples, un deuxième réseau de cellules duales (F) fonctionnant en logique complémentaire sur la deuxième composante, les fonctions logiques étant réalisées par chaque couple de cellules (T, F) en une phase de précharge (21) mettant les variables dans un état connu à l'entrée des cellules suivie d'une phase d'évaluation (22) où un calcul est effectué par les cellules, ledit procédé étant caractérisé en ce qu'une anomalie est détectée par au moins un état non cohérent. L'invention a aussi pour objet un circuit protégé par logique différentielle comportant des moyens pour tester la cohérence entre les deux composantes des variables logiques durant les phases de précharge ou d'évaluation aux nuds surveillés du circuit.
Danger Jean-Luc
Flament Florent
Guilley Sylvain
Institut Telecom - Telecom Paristech
Marks & Clerk
LandOfFree
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Profile ID: LFCA-PAI-O-1497695