H - Electricity – 04 – N
Patent
H - Electricity
04
N
H04N 7/025 (2006.01) H04L 5/00 (2006.01) H04L 25/45 (2006.01) H04B 1/40 (2006.01)
Patent
CA 2416052
The present invention relates to a serial interface transmission system with more than one data line, in which the transmitted data has in-band and out-of- band characters. More particularly, the present invention relates to methods and systems for sending side channel data over a high-speed digital communications link, e.g., a video link. One embodiment of the invention provides a high-speed digital transmitter capable of sending side channel data. The transmitter includes a channel zero encoder, a multiplexer, data enable out (DEout) control logic, and a channel one encoder. The channel one encoder receives input from the channel one multiplexer and the channel one DEout control logic. Another embodiment of the invention provides a high-speed digital receiver capable of receiving side channel data. The receiver includes a channel zero decoder, a channel one decoder, DEI signal and FIFO control signal recovery logic, and a channel one de-multiplexer. The DEI signal and FIFO control signal recovery logic receives input from the channel one decoder. Similarly, the channel one demultiplexer receives input from the channel one decoder.
L'invention concerne un système de transmission d'interface série comportant plus d'une ligne de données et dans lequel les données transmises possèdent des caractères en-bande et hors-bande. Elle concerne, plus particulièrement, des procédés et des systèmes permettant d'envoyer des données collatérales par l'intermédiaire d'une liaison de communication numérique extrêmement rapide, par exemple, une liaison vidéo. Un mode de réalisation concerne un émetteur numérique extrêmement rapide pouvant envoyer des données collatérales. Cet émetteur comprend un codeur de canal 0, un multiplexeur, une logique de contrôle de validation de données (DE¿out?) et un codeur de canal 1. Ce dernier reçoit une entrée du multiplexeur de canal 1 et de la logique de contrôle DE¿out? de canal 1. Un autre mode de réalisation concerne un récepteur numérique extrêmement rapide pouvant recevoir des données collatérales. Ce récepteur comprend un décodeur de canal 0, un décodeur de canal 1, une logique de récupération de signal DEI et de signal de contrôle FIFO, ainsi qu'un démultiplexeur de canal 1. La logique de récupération de signal DEI et de signal de contrôle FIFO reçoit une entrée de décodeur de canal 1. De même, le démultiplexeur de canal 1 reçoit une entrée du décodeur de canal 1.
Kim Gyudong
Kim Min-Kyu
Silicon Image Inc.
Smart & Biggar
LandOfFree
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Profile ID: LFCA-PAI-O-2078017