Microprocessor decoder frequency hopping spread spectrum...

H - Electricity – 04 – B

Patent

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H04B 1/69 (2006.01) H04B 1/713 (2006.01)

Patent

CA 2491397

The present invention is directed to a frequency hopping spread spectrum transceiver. The transceiver includes a microcontroller (110); a transmitter (120) having a voltage controlled oscillator (122), a direct digital synthesizer (124), and a power amplifier (126); and a receiver having an amplifier (128), an IF amplifier (132), a demodulator (134), and a data slicer (138). When transmitting, the transmitter sends a preamble that allows the receiving device to detect the signal and lock to it to receive the data. When receiving, the receiver first scans all channels and sorts them based on a Received Signal Strength Indicator (RSSI) and then attempts to lock to the channel with the strongest RSSI value by first sampling the received signal to verify the preamble, then synchronizing to the bit edges of the received signal, then detecting the start of a Start Frame Delimiter (SFD), decoding bits to verify a valid SFD and then sampling data bits to receive the data.

L'invention concerne un émetteur-récepteur à spectre dispersé à saut de fréquence. Ledit émetteur-récepteur comprend un microdispositif de commande (110) ; un émetteur (120) présentant une tension commandée par un oscillateur (122) ; un synthétiseur numérique direct (124) ; un amplificateur de puissance (126) ; un récepteur présentant un amplificateur (128), un amplificateur FI (132), un démodulateur (134), et un sélectionneur de données (138). Lors de l'émission, l'émetteur envoie un préambule qui permet au dispositif de réception de détecter le signal et de le bloquer pour recevoir des données. Lors de la réception, le récepteur balaie en premier toutes les voies et les trie sur la base d'un indicateur de puissance de signal reçu (RSSI), puis tente de verrouiller la voie au moyen de la valeur la plus grande du RSSI, en effectuant un échantillonnage du signal reçu pour vérifier le préambule, puis en synchronisant les fronts de bits du signal reçu, puis en détectant le début d'un délimiteur de cadre de début (SFD), en décodant les bits pour vérifier un SFD valide grâce à l'échantillonnage des bits de données pour recevoir les données.

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